d'erreur> dans l'ADC

[moisiad]

Salut à tous

Dans l'échantillon et maintenez stade de gazoduc de 1,5 bit CDA convertisseur, quand j'ai le-Vout Vin caractéristique de la scène (celle avec les triangles), j'ai remarqué que la caractéristique tout est décalé par 60mV.
Je suppose que c'est le décalage d'erreur systématique qui n'est pas si critique (selon certains livres).Suis-je Wright?Quelles sont les sources possibles de cette erreur?

("SUNKING" J'attends ton aide

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)

Merci

 

[snoop835]

Si vous utilisez comparateur à capacités commutées dans votre échantillon et maintenez-circuit, la tension de décalage de votre comparateur peut contribuer à compenser les erreurs de votre ADC.A haute fréquence, la tension de décalage du comparateur peut être en millivolts gamme.

 

[philipwang]

Juste le S / H stade?Je sais que comparaison n'est pas adopté à ce stade.
La «compensation» est entre les entrées telles que le péché-ondes et un exemple de sortie?Cela peut être systématique offset, vient aussi peut-être de l'idéal CMFB non de l'AMP.Essayez de régler le CMFB et voir ce qui se passe.

Bg,

 

[SUNKING]

Oui, je degré avec philipwang's.
il peut-être venu de CMFB.

 

[moisiad]

Merci à tous

J'ai fixé le premier décalage de tous en modifiant la taille des transistors de sortie dans le OPAMP et deuxième à l'aide de l'échantillon et maintenez stade linéaire condensateurs plus au lieu de la MosCap.Cependant à partir de simulations, j'ai remarqué que ce genre d'erreur n'est pas critique pour l'opération ADC.

Maintenant je suis face à un autre problème (je l'espère, la finale).Quand j'ai mis une entrée rampe de sortie est celle illustrée dans la première parcelle ci-joint.Comme vous le voyez il ya des grands pas (codes manquants) en des points précis.

Dans la deuxième parcelle est le résidu des 4 premières étapes.Vous pouvez voir que, à partir de la deuxième étape, le niveau maximal de tous les triangles de la même scène n'est pas la même.C'est là où je obtenir les codes manquants.

Avez-vous quelque chose à proposer?

(L'appareil est un 8-pipeline CDA avec la DMV = 1V et f = 40 MHz. Chaque étape comporte deux niveaux de référence et 0,25 V 0,75 V, je ne suis pas en utilisant dans ce cas la configuration de scène en 1.5bit)

Merci beaucoup
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