I
Iouri
Guest
vous pouvez utiliser Active HDL pour concevoir machine d'état avec une interface graphique
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L
lawrence_idol
Guest
Etat design de la machine est un plaisir et un défi ...
certaine façon, je ne voit aucune interface graphique pour la conception de machine d'état.
S'il vous plaît, ne sautez pas les étapes lorsque vous êtes dans l'état d'apprentissage ..
tu vas le regretter dans la finale.
certaine façon, je ne voit aucune interface graphique pour la conception de machine d'état.
S'il vous plaît, ne sautez pas les étapes lorsque vous êtes dans l'état d'apprentissage ..
tu vas le regretter dans la finale.
K
kostbill
Guest
Bonjour.
J'ai à la fois ISE Xilinx et Altera qu () RTUs AT,
Comment puis-je concevoir une machine à états avec un outil graphique?
Yat-il des correctifs logiciels pour cela?
Ou il existe des solutions logicielles complètement différent pour ce que c'est?
J'espère que ces sont gratuits (si elles existent!)
Aussi, je voudrais voir le circuit composé à la fin.
Merci beaucoup.
J'ai à la fois ISE Xilinx et Altera qu () RTUs AT,
Comment puis-je concevoir une machine à états avec un outil graphique?
Yat-il des correctifs logiciels pour cela?
Ou il existe des solutions logicielles complètement différent pour ce que c'est?
J'espère que ces sont gratuits (si elles existent!)
Aussi, je voudrais voir le circuit composé à la fin.
Merci beaucoup.