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SweetMusic
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Dernière édition par SweetMusic le 11 Jan 2009 23:43, édité 1 fois au total
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R
ring0
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Le plus grand morceau de «adresse» sera de 0, et les autres bits sera égal à bits correspondants de "ir".
F
FVM
Guest
Fondamentalement, l'expression de droite est à partir de trois éléments de syntaxe: une constante, un enchaînement et une partie SELECT.Si vous souhaitez utiliser Verilog, vous devez apprendre les éléments de syntaxe de base, soit d'un livre de texte ou un manuel de référence bien.
Le compilateur Synopsys HDL manuel est bonne, à mon avis:
http://www.stanford.edu/class/ee108b/labs/verilog_reference.pdf
Le compilateur Synopsys HDL manuel est bonne, à mon avis:
http://www.stanford.edu/class/ee108b/labs/verilog_reference.pdf
S
SweetMusic
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thx
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F
FVM
Guest
Quote:
vous n'avez pas vraiment répondu à ma question
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