V
vreddy
Guest
quelqu'un peut-il expain, pour donner à la logique CMOS à diverses techniques pour minimiser les conso pouvoir.???
merci d'avance .....
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I
irfansyah
Guest
Un moyen consiste à abaisser la tension d'alimentation, il donne les économies d'énergie quadratique, idéalement.
Dimensionnement des transistors également les choses, par exemple, d'un onduleur, il est suggéré que la pente de transition de sortie est beaucoup plus longue que la montée d'entrée / temps de descente, de réduire la dissipation de courant statique.Mais encore une fois, si on regarde le tableau d'ensemble, les rendant à peu près la même chose est une approche raisonnable.
Dimensionnement des transistors également les choses, par exemple, d'un onduleur, il est suggéré que la pente de transition de sortie est beaucoup plus longue que la montée d'entrée / temps de descente, de réduire la dissipation de courant statique.Mais encore une fois, si on regarde le tableau d'ensemble, les rendant à peu près la même chose est une approche raisonnable.
M
manu_leo
Guest
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