G
Guru59
Guest
Salut tout le monde ...........Quelqu'un peut-il m'expliquer le concept de pipeline et de son utilisation ....Merci
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Quelqu'un peut-il m'expliquer le concept de pipeline et de son utilisation ....
B
buark
Guest
laisse supposer que vous et votre colocataire veux faire cuire des spaghettis avec de la salade individuellement.Si vous habitez la cuisine durant tout votre processus de cuisson de votre ami doit attendre longtemps pour commencer son processus de cuisson, mais si vous le laissez à utiliser la cuisinière pendant que vous préparez la salade ce serait pipeline.
S
Salma Ali Bakr
Guest
yah exactement
ou quand u veux faire ur de blanchisserie, puis séchez-le puis de fer
si u ont une machine à laver, un séchoir et un fer à repasser dans la chambre (et ils sont tous partagés entre plusieurs)
et U sont trois amis, par exemple, A, B et C
Un ami peut commencer à faire tout le processus du début à la fin, en utilisant toutes les ressources dans la salle et ne pas permettre à quiconque de les partager
ou il peut commencer à se laver, puis dès qu'il commence à sécher, l'ami de B commence à laver
et quand il commence à repasser, B ami serait séchage et C ami commencerait à laver
ce serait parfait, bien sûr, si tous les processus prendra le même temps
mais ce n'est pas toujours le cas
de sorte que tous seraient d'attente pour celui qui prend le plus de temps
et le temps total dans lequel ils seront tous finir en dépendra également que
<img src="http://www.edaboard.com/images/smiles/icon_smile.gif" alt="Sourire" border="0" />
ou quand u veux faire ur de blanchisserie, puis séchez-le puis de fer
si u ont une machine à laver, un séchoir et un fer à repasser dans la chambre (et ils sont tous partagés entre plusieurs)
et U sont trois amis, par exemple, A, B et C
Un ami peut commencer à faire tout le processus du début à la fin, en utilisant toutes les ressources dans la salle et ne pas permettre à quiconque de les partager
ou il peut commencer à se laver, puis dès qu'il commence à sécher, l'ami de B commence à laver
et quand il commence à repasser, B ami serait séchage et C ami commencerait à laver
ce serait parfait, bien sûr, si tous les processus prendra le même temps
mais ce n'est pas toujours le cas
de sorte que tous seraient d'attente pour celui qui prend le plus de temps
et le temps total dans lequel ils seront tous finir en dépendra également que
<img src="http://www.edaboard.com/images/smiles/icon_smile.gif" alt="Sourire" border="0" />
B
banjo
Guest
Bien que les exemples ci-dessus vous donne les notions générales, vous pouvez vous demander pourquoi vous feriez cela dans un FPGA.Pipeline de FPGA est souvent fait de ne pas se faire deux emplois en même temps.Si est souvent utilisée pour obtenir un emploi unique fait à une vitesse élevée.
Dans un FPGA, la contrainte de limitation est le nombre d'opérations logiques qui peut être accompli dans un cycle d'horloge.Depuis des opérations logiques complexes doivent être réparties entre de nombreux LUT (Look Up Tables), et toutes les tables de conversion doit être acheminé avec routage interne, vous obtenir rapidement la proposition des retards qui sont supérieures à un cycle d'horloge.Pour corriger cela, vous utilisez plusieurs cycles d'horloge pour accomplir la tâche totale avec à chaque étape de tuyaux et petite portion de la tâche étant achevée.C'est un peu comme l'approche la chaîne de montage de voitures de construction.Chaque nombre de secondes alors, les avancées d'assemblage d'une station.À chaque station, un travailleur ne une tâche.Lorsque la ligne est en marche, une nouvelle voiture qui roule sur la ligne chaque fois que la ligne avance.Par conséquent, ils semblent faire une voiture pour "horloge".Un seul travailleur ne peut pas faire une voiture entière dans une «horloge», comme il ou elle ne peut se faire toutes les tâches que rapide.Mais de nombreux travailleurs chacun faisant une petite partie peut ainsi faire d'une voiture pour "horloge".L'inconvénient, c'est qu'il faut un certain temps pour obtenir la ligne d'assemblage entièrement chargé au début des quarts de travail, parce que les travailleurs plus loin dans la chaîne de montage à attendre pour les voitures partielle pour se rendre à eux.Aussi, leur est une pénalité de temps lorsque vous voulez changer les options sur les voitures que vous faites, parce que vous devez attendre que la ligne d'assemblage pour évacuer les voitures qui sont en partie fait.
Pipelines dans les FPGA de la même façon.Vous devez casser les tâches en petits morceaux qui peuvent être accomplies en un seul cycle d'horloge.Ensuite, vous devez suivre à quel stade de l'oléoduc chaque signal a été généré pour que vous puissiez les recombiner dans le bon ordre.Par exemple, disons que vous devez l'ET de la sortie de deux opérations logiques.Une opération a été calculé à l'étape 2 et l'autre a été calculé à l'étape 4.Vous devez retard de l'étape 2 résultat deux horloges supplémentaires afin qu'il s'aligne avec le stade 4 résultats.La sortie de l'ADN serait alors enregistré avec un flop et serait à l'étape 5 de l'oléoduc.
Dans un FPGA, la contrainte de limitation est le nombre d'opérations logiques qui peut être accompli dans un cycle d'horloge.Depuis des opérations logiques complexes doivent être réparties entre de nombreux LUT (Look Up Tables), et toutes les tables de conversion doit être acheminé avec routage interne, vous obtenir rapidement la proposition des retards qui sont supérieures à un cycle d'horloge.Pour corriger cela, vous utilisez plusieurs cycles d'horloge pour accomplir la tâche totale avec à chaque étape de tuyaux et petite portion de la tâche étant achevée.C'est un peu comme l'approche la chaîne de montage de voitures de construction.Chaque nombre de secondes alors, les avancées d'assemblage d'une station.À chaque station, un travailleur ne une tâche.Lorsque la ligne est en marche, une nouvelle voiture qui roule sur la ligne chaque fois que la ligne avance.Par conséquent, ils semblent faire une voiture pour "horloge".Un seul travailleur ne peut pas faire une voiture entière dans une «horloge», comme il ou elle ne peut se faire toutes les tâches que rapide.Mais de nombreux travailleurs chacun faisant une petite partie peut ainsi faire d'une voiture pour "horloge".L'inconvénient, c'est qu'il faut un certain temps pour obtenir la ligne d'assemblage entièrement chargé au début des quarts de travail, parce que les travailleurs plus loin dans la chaîne de montage à attendre pour les voitures partielle pour se rendre à eux.Aussi, leur est une pénalité de temps lorsque vous voulez changer les options sur les voitures que vous faites, parce que vous devez attendre que la ligne d'assemblage pour évacuer les voitures qui sont en partie fait.
Pipelines dans les FPGA de la même façon.Vous devez casser les tâches en petits morceaux qui peuvent être accomplies en un seul cycle d'horloge.Ensuite, vous devez suivre à quel stade de l'oléoduc chaque signal a été généré pour que vous puissiez les recombiner dans le bon ordre.Par exemple, disons que vous devez l'ET de la sortie de deux opérations logiques.Une opération a été calculé à l'étape 2 et l'autre a été calculé à l'étape 4.Vous devez retard de l'étape 2 résultat deux horloges supplémentaires afin qu'il s'aligne avec le stade 4 résultats.La sortie de l'ADN serait alors enregistré avec un flop et serait à l'étape 5 de l'oléoduc.
A
alzomor
Guest
Salut
Vous pouvez trouver une bonne explication à Hennesy & Patterson livre
«Architecture des ordinateurs d'une approche Qauntitive"
Salam
Hossam Alzomor
ww.ig.org
Vous pouvez trouver une bonne explication à Hennesy & Patterson livre
«Architecture des ordinateurs d'une approche Qauntitive"
Salam
Hossam Alzomor
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