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ls000rhb
Guest
salut tous
Pouvez-vous
m'aider à résoudre cet avertissement
Dans ma conception, il existe un module de diviser clock_divider source d'horloge à plusieurs horloges à utiliser dans d'autres modules.
Lors de l'exécution de synthèse dans Synplify, Afficher un avertissement "Suppression de u_clock_divider instance de vue: work.clock_divider (verilog) car il
n'existe pas de références à ses résultats.
Je ne sais pas ce que cela signifie avertissements.
la manière de résoudre cet avertissement?
Merci
et Cordialement
Pouvez-vous
m'aider à résoudre cet avertissement
Dans ma conception, il existe un module de diviser clock_divider source d'horloge à plusieurs horloges à utiliser dans d'autres modules.
Lors de l'exécution de synthèse dans Synplify, Afficher un avertissement "Suppression de u_clock_divider instance de vue: work.clock_divider (verilog) car il
n'existe pas de références à ses résultats.
Je ne sais pas ce que cela signifie avertissements.
la manière de résoudre cet avertissement?
Merci
et Cordialement